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VSP5612 库存 & 价格

TI The VSP5610/11/12 are high-speed, high-performance, 16Bit analog-to-digital-converters (ADCs) that have four independent sampling circuit channels for multi-output charge-coupled device (CCD) and complementary metal oxide semiconductor (CMOS) line s
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VSP5612 TI
TI
  • 制造商:
    TI
  • 制造商型号#:
    VSP5612
  • 百芯编号#:
    CM637189246
  • 价格(CNY):
  • 百芯库存:
    247
  • 可供应量:
    168 个在库
    此为供应商库存,需要与销售确认
  • 产品描述:
    The VSP5610/11/12 are high-speed, high-performance, 16Bit analog-to-digital-converters (ADCs) that have four independent sampling circuit channels for multi-output charge-coupled device (CCD) and complementary metal oxide semiconductor (CMOS) line s
  • 文档: 符合 RoHS 标准 3D模型
VSP5612 购买 VSP5612 库存和价格更新于 2025-06-14 03:50:22
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    器件型号: VSP5612
    百芯编号: CM637189246
    制造商: TI
    价格
    总计: 415
    MOQ: 1
    库存地点: 香港
    发货日期: 2025/06/19 (预期 )
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    TI
    封装
    VQFN-56
    3D模型
     3D模型
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    VSP5612 数据规格书
    VSP5612 数据手册Datasheet
    47 Pages, 841 KB
    2012/04/03
    查看
    符合标准
    类型
    描述
    RoHS标准
    RoHS Compliant
    含铅标准
    Lead Free
    产品概述
    • The VSP5610/11/12 are high-speed, high-performance, 16-bit analog-to-digital-converters (ADCs) that have four independent sampling circuit channels for multi-output charge-coupled device (CCD) and complementary metal oxide semiconductor (CMOS) line sensors. Pixel data from the sensor are sampled by the sample/hold (SH) or correlated double sampler (CDS) circuit, and are then converted to digital data by an ADC. Data output is selectable in low-voltage differential signaling (LVDS) or CMOS modes.
    • The VSP5610/11/12 include a programmable gain to support the pixel level inflection caused by luminance. The integrated digital-to-analog-converter (DAC) can be used to adjust the offset level for the analog input signal. Furthermore, the timing generator (TG) is integrated in these devices for the control of sensor operation.
    • The VSP5610/11/12 use 1.65 V to 1.95 V for the core voltage and 3.0 V to 3.6 V for I/Os. The core voltage is supplied by a built-in low-dropout regulator (LDO).
    • Four-Channel CCD/CMOS Signal: 2-Channel, 3-Channel, and 4-Channel Selectable
    • Power Supply: 3.3 V Only, Typ
    • (Built-in LDO, 3.3 V to 1.8 V)
    • Maximum Conversion Rate:
    • VSP5610: 35 MSPS
    • VSP5611: 50 MSPS
    • VSP5612: 70 MSPS
    • 16-Bit Resolution
    • CDS/SH Selectable
    • Maximum Input Signal Range: 2.0 V
    • Analog and Digital Hybrid Gain:
    • Analog Gain: 0.5 V/V to 3.5 V/V in
    • 3/64-V/V Steps
    • Digital Gain: 1 V/V to 2 V/V in
    • 1/256-V/V Steps
    • Offset Correction DAC: ±250 mV, 8-Bit
    • Standard LVDS/CMOS Selectable Output:
    • LVDS:Data Channel: 2-Channel, 3-ChannelClock Channel: 1-Channel8-Bit/7-Bit Serializer Selectable
    • CMOS: 4 Bits × 4, 8 Bits × 2
    • Timing Generator:
    • Fast Transfer Clock: Eight Signals
    • Slow Transfer Clock: Six Signals
    • Timing Adjustment Resolution: tMCLK/48
    • Input Clamp/Input Reference Level Internal/External Selectable
    • Reference DAC: 0.5 V, 1.1 V, 1.5 V, 2 V
    • SPI™: Three-Wire Serial
    • GPIO: Four-Port
    • * APPLICATIONS
    • Copiers
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