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SN74LS191N 库存 & 价格

TI TEXAS INSTRUMENTS SN74LS191N Binary Synchronous Up / Down Counter, LS Family, 25MHz, 4.75V to 5.25V, DIP-16
6.03
SN74LS191N
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SN74LS191N TI
TI
  • 制造商:
    TI
  • 制造商型号#:
    SN74LS191N
  • 百芯编号#:
    CM7983981
  • 价格(CNY):
    6.03
  • 百芯库存:
    247
  • 可供应量:
    177 个在库
    此为供应商库存,需要与销售确认
  • 产品类别:
    计数器
  • 产品描述:
    TEXAS INSTRUMENTS SN74LS191N Binary Synchronous Up / Down Counter, LS Family, 25MHz, 4.75V to 5.25V, DIP-16
  • 文档: 3D模型
SN74LS191N 购买 SN74LS191N 库存和价格更新于 2025-06-11 03:50:22
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    器件型号: SN74LS191N
    百芯编号: CM7983981
    制造商: TI
    封装: PDIP-16
    价格
    6.03
    总计: 424
    MOQ: 1
    库存地点: 香港
    发货日期: 2025/06/16 (预期 )
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    类型
    描述
    选择
    制造商
    TI
    类别
    计数器
    3D模型
     3D模型
    安装方式
    Through Hole
    引脚数
    16 Pin
    封装
    PDIP-16
    频率
    25 MHz
    数字逻辑电平
    CMOS
    电源电压(DC)
    4.75V ~ 5.25V
    输出接口数
    4 Output
    电路数
    1 Circuit
    针脚数
    16 Position
    时钟频率
    25 MHz
    位数
    4 Bit
    电压波节
    5.00 V
    输出电流驱动
    -50.0 µA
    输入数
    4 Input
    工作温度(Max)
    70 ℃
    工作温度(Min)
    0 ℃
    电源电压
    4.75V ~ 5.25V
    电源电压(Max)
    5.25 V
    电源电压(Min)
    4.75 V
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    SN74LS191N 数据规格书
    SN74LS191N 数据手册Datasheet
    16 Pages, 1057 KB
    2013/04/09
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    SN74LS191N 数据手册Datasheet
    16 Pages, 688 KB
    2010/02/17
    查看
    SN74LS191N 数据手册Datasheet
    16 Pages, 718 KB
    2012/03/28
    查看
    SN74LS191N 其它数据手册Datasheet
    14 Pages, 513 KB
    查看
    尺寸 & 包装
    类型
    描述
    长度
    19.3 mm
    宽度
    6.35 mm
    高度
    4.57 mm
    重量
    0.015227096868 kg
    工作温度
    0℃ ~ 70℃
    产品生命周期
    Active
    包装方式
    Tube
    符合标准
    类型
    描述
    RoHS标准
    RoHS Compliant
    含铅标准
    Lead Free
    REACH SVHC标准
    No SVHC
    REACH SVHC版本
    2015/06/15
    出口分类
    类型
    描述
    ECCN代码
    EAR99
    产品概述
    • The SN74LS191N is a 4-bit synchronous Up/Down Counter with up/down mode control. It has a complexity of 58 equivalent gates. Synchronous operation is provided by having all flip-flops clocked simultaneously so that the outputs change coincident with each other when so instructed by the steering logic. This mode of operation eliminates the output counting spikes normally associated with asynchronous counters. The outputs of the four master-slave flip-flops are triggered on a low-to-high transition of the clock input if the enable input is low. A high at the enable input inhibits counting. Level changes at the enable input should be made only when the clock input is high. The direction of the count is determined by the level of the down/up input. When low, the counter count up and when high, it counts down. A false clock may occur if the down/up input changes while the clock is low.
    • Counts 8-4-2-1 BCD or binary
    • Single down/up count control line
    • Count enable control input
    • Ripple clock output for cascading
    • Asynchronously presettable with load control
    • Parallel outputs
    • Cascadable for N-bit applications

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